吉林PCI-E测试保养

时间：2023年03月07日来源：

在测试通道数方面，传统上PCIe的主板测试采用了双口(Dual-Port)测试方法，即需要把被测的一条通道和参考时钟RefClk同时接入示波器测试。由于测试通道和RefClk都是差分通道，所以在用电缆直接连接测试时需要用到4个示波器通道(虽然理论上也可以用2个差分探头实现连接，但是由于会引入额外的噪声，所以直接电缆连接是常用的方法),这种方法的优点是可以比较方便地计算数据通道相对于RefClk的抖动。但在PCIe5.0中，对于主板的测试也采用了类似于插卡测试的单口(Single-Port)方法，即只把被测数据通道接入示波器测试，这样信号质量测试中只需要占用2个示波器通道。图4.23分别是PCIe5.0主板和插卡信号质量测试组网图，芯片封装和一部分PCB走线造成的损耗都是通过PCI-SIGPCI-E3.0定义了11种发送端的预加重设置，实际应用中应该用那个？吉林PCI-E测试保养

这么多的组合是不可能完全通过人工设置和调整的，必须有一定的机制能够根据实际链路的损耗、串扰、反射差异以及温度和环境变化进行自动的参数设置和调整，这就是链路均衡的动态协商。动态的链路协商在PCIe3.0规范中就有定义，但早期的芯片并没有普遍采用；在PCIe4.0规范中，这个要求是强制的，而且很多测试项目直接与链路协商功能相关，如果支持不好则无法通过一致性测试。图4.7是 PCIe的链路状态机，从设备上电开始，需要经过一系列过程才能进入L0的正常工作状态。其中在Configuration阶段会进行简单的速率和位宽协商，而在Recovery阶段则会进行更加复杂的发送端预加重和接收端均衡的调整和协商。辽宁PCI-E测试故障PCI-E测试和协议调试；

PCle5.0的链路模型及链路损耗预算在实际的测试中，为了把被测主板或插卡的PCIe信号从金手指连接器引出，PCI-SIG组织也设计了专门的PCIe5.0测试夹具。PCle5.0的这套夹具与PCle4.0的类似，也是包含了CLB板、CBB板以及专门模拟和调整链路损耗的ISI板。主板的发送信号质量测试需要用到对应位宽的CLB板；插卡的发送信号质量测试需要用到CBB板；而在接收容限测试中，由于要进行全链路的校准，整套夹具都可能会使用到。21是PCIe5.0的测试夹具组成。

按照测试规范的要求，在发送信号质量的测试中，只要有1个Preset值下能够通过信号质量测试就算过关；但是在Preset的测试中，则需要依次遍历所有的Preset,并依次保存波形进行分析。对于PCIe3.0和PCIe4.0的速率来说，由于采用128b/130b编码，其一致性测试码型比之前8b/10b编码下的一致性测试码型要复杂，总共包含36个128b/130b的编码字。通过特殊的设计，一致性测试码型中包含了长“1”码型、长“0”码型以及重复的“01” 码型，通过对这些码型的计算和处理，测试软件可以方便地进行预加重、眼图、抖动、通道损耗的计算。 11是典型PCle3.0和PCIe4.0速率下的一致性测试码型。pcie物理层面检测,pcie时序测试；

随着数据速率的提高，在发送端对信号高频进行补偿还是不够，于是PCIe3.0及之后的标准中又规定在接收端(RX端)还要对信号做均衡(Equalization),从而对线路的损耗进行进一步的补偿。均衡电路的实现难度较大，以前主要用在通信设备的背板或长电缆传输的场合，近些年也逐渐开始在计算机、消费类电子等领域应用，比如USB3.0、SATA 6G、DDR5中也均采用了均衡技术。图4 .4分别是PCIe3 .0和4 .0标准中对CTLE均衡器的频响特性的要求。可以看到，均衡器的强弱也有很多挡可选，在Link Training阶段TX 和RX端会协商出一个比较好的组合(参考资料： PCI ExpressR Base Specification 4 .0)。PCI-E 3.0数据速率的变化；安徽信息化PCI-E测试

网络分析仪测试PCIe gen4和gen5，sdd21怎么去除夹具的值?吉林PCI-E测试保养

如前所述，在PCle4.0的主板和插卡测试中，PCB、接插件等传输通道的影响是通过测试夹具进行模拟并且需要慎重选择ISI板上的测试通道，而对端接收芯片封装对信号的影响是通过软件的S参数嵌入进行模拟的。测试过程中需要用示波器软件或者PCI-SIG提供的测试软件把这个S参数文件的影响加到被测波形上。

PCIe4.0信号质量分析可以采用两种方法：一种是使用PCI-SIG提供的Sigtest软件做手动分析，另一种是使用示波器厂商提供的软件进行自动测试。吉林PCI-E测试保养

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